臺灣學術機構典藏系統 (Taiwan Academic Institutional Repository, TAIR)

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机构	日期	题名	作者
臺大學術典藏	2019-10-24T07:57:19Z	Algorithm-Based Low-Power Transform Coding Architectures: The Multirate Approach	吳安宇;AN-YEU(ANDY) WU;K. J. R. Liu;An-Yeu Wu; An-Yeu Wu; K. J. R. Liu; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:19Z	Algorithm-Based Low-Power and High-Performance Multimedia Signal Processing	吳安宇;AN-YEU(ANDY) WU;J. Chen;A. Raghupathy;An-Yeu Wu;K. J. R. Liu; K. J. R. Liu; An-Yeu Wu; A. Raghupathy; J. Chen; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:19Z	System Architecture of an Adaptive Reconfigurable DSP Computing Engine	吳安宇;AN-YEU(ANDY) WU;A. Raghupathy;K. J. R. Liu;An-Yeu Wu; An-Yeu Wu; K. J. R. Liu; A. Raghupathy; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:19Z	Split Recursive Least-Squares: Algorithms, Architectures, and Applications	吳安宇;AN-YEU(ANDY) WU;K. J. R. Liu;An-Yeu Wu; An-Yeu Wu; K. J. R. Liu; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:18Z	A Unified View for Vector Rotational CORDIC Algorithms and Architectures based on Angle Quantization Approach	吳安宇;AN-YEU(ANDY) WU;Cheng-Shing Wu;An-Yeu Wu; An-Yeu Wu; Cheng-Shing Wu; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:17Z	High-Performance VLSI Architecture of Adaptive Decision Feedback Equalizer Based on Predictive Parallel Branch Slicer (PPBS) Scheme	吳安宇;AN-YEU(ANDY) WU;Jyh-Ting (Justin) Lai;An-Yeu Wu;Meng-Da Yang; Meng-Da Yang; An-Yeu Wu; Jyh-Ting (Justin) Lai; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:17Z	Fast Convergent Pipelined Adaptive DFE Architecture Using Post-Cursor Processing Filter Technique	吳安宇;AN-YEU(ANDY) WU;Jyh-Ting Lai;An-Yeu Wu;Meng-Da Yang; Meng-Da Yang; An-Yeu Wu; Jyh-Ting Lai; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:17Z	VLSI Design of a Variable-Length FFT/IFFT Processor for OFDM-based Communication Systems	吳安宇;AN-YEU(ANDY) WU;An-Yeu Wu;Chih-Hsiu Lin;Ching-Hua Wen;Jen-Chih Kuo; Jen-Chih Kuo; Ching-Hua Wen; Chih-Hsiu Lin; An-Yeu Wu; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:16Z	On The New Stopping Criteria of Iterative Turbo Decoding by Using Decoding Threshold	吳安宇;AN-YEU(ANDY) WU;An-Yeu Wu;Fan-Min Li; Fan-Min Li; An-Yeu Wu; AN-YEU(ANDY) WU; 吳安宇
臺大學術典藏	2019-10-24T07:57:16Z	Joint AGC-Equalization (Joint AGC-EQ) Algorithm and VLSI Architecture For Wirelined Transceiver Designs	吳安宇;AN-YEU(ANDY) WU;Chien-Hsiung Lee;An-Yeu Wu;Jyh-Ting Lai; Jyh-Ting Lai; An-Yeu Wu; Chien-Hsiung Lee; AN-YEU(ANDY) WU; 吳安宇

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